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當(dāng)前位置 首頁(yè) 人才隊(duì)伍
  • 姓名： 黃水龍
  • 性別： 男
  • 職稱： 副研究員
  • 職務(wù)： 
  • 學(xué)歷： 博士
  • 電話： 010-82995600
  • 傳真： 010-82995812
  • 電子郵件： huangshuilong@ime.ac.cn
  • 所屬部門： 科技處
  • 通訊地址： 北京市朝陽(yáng)區(qū)北土城西路3號(hào)

    簡(jiǎn)　　歷：

  • 教育背景

    1994年9月-1998年7月 南京航空航天大學(xué) 機(jī)械工程系 學(xué)士

    1999年9月-2002年7月 華中科技大學(xué) 電力工程系 碩士

    2002年9月-2007年7月 清華大學(xué) 電子工程系 博士

    工作簡(jiǎn)歷

    1998年7月-1999年8月 湖北武漢181廠 技術(shù)員

    2007年7月-至今 中國(guó)科學(xué)院微電子研究所 副研究員，碩士生導(dǎo)師

    社會(huì)任職：

    研究方向：

  • 射頻/模擬/混合集成電路設(shè)計(jì)和測(cè)試

    承擔(dān)科研項(xiàng)目情況：

  • 2009年，國(guó)家科技重大專項(xiàng)，嵌入式多模，多頻無(wú)線收發(fā)器IP核，副組長(zhǎng)；

    2009年，國(guó)家科技重大事項(xiàng)，TD-LTE終端射頻芯片研發(fā)，副組長(zhǎng)；

    2010年，國(guó)家科技重大專項(xiàng)，TD-LTE面向商用終端射頻芯片研發(fā)，副組長(zhǎng)；

    2011年，國(guó)家科技重大專項(xiàng)，TD-LTE-Advanced終端射頻芯片工程樣品研發(fā)， 副組長(zhǎng)；

    2012年 國(guó)家科技重大專項(xiàng)，TD-LTE多頻射頻商用芯片研發(fā)，副組長(zhǎng)；

    2012年 國(guó)家科技重大專項(xiàng)，高性能 ADC IP，項(xiàng)目負(fù)責(zé)人；

    2012年 國(guó)家科技重大專項(xiàng)，自主IP核在SoC芯片中的批量應(yīng)用（射頻），組長(zhǎng)；

    2013年 多頻段射頻IP芯片研發(fā)，公司委托項(xiàng)目，項(xiàng)目負(fù)責(zé)人。

    代表論著：

  • [1] Shuilong Huang, Zhihua Wang. Phase self-calibrated scheme for zero-IF receiver, Analog Integrated Circuits and Signal Processing, 2007, 51(1): 33-37

    [2] Shuilong Huang, Zhihua Wang. An improved charge-averaging charge-pump scheme, Analog Integrated Circuits and Signal Processing, 2007, 51(1): 45-49.

    [3] Shuilong Huang, Zhihua Wang. Behavioral modeling and simulation of fractional-N frequency synthesizer, Analog Integrated Circuits and Signal Processing, 2009, 59(3) 317-323.

    [4] Shuilong Huang, Zhihua Wang. System design consideration of highly-integrated ΣΔ fractional-n frequency synthesizer, 2008, 17(2): 169-181.

    [5] Shuilong Huang, Zhihua Wang. A dual-slope PFD/CP frequency synthesizer architecture with adaptive self-tuning algorithm, 2007 IEEE integrated Symposium on Circuit and Systems，3924-3927.

    [6] Shuilong Huang, Haiying Zhang. A fractional spur suppression technique in the fractional-N frequency synthesizer. Analog Integrated Circuits and Signal Processing, 2010, 66(3): 455-458.

    [7] 譯著：黃水龍，王小松，劉欣，武振宇，基于標(biāo)準(zhǔn)CMOS工藝的低功耗射頻電路設(shè)計(jì)，國(guó)防工業(yè)出版社，2013.

    專利申請(qǐng)：

  • 1. 可實(shí)現(xiàn)頻段選擇的自校正鎖相環(huán)頻率綜合器（200910077363.4）

    2. 用于快速建立寬鎖定范圍鎖相環(huán)頻率綜合器中的擴(kuò)展鑒相鑒頻器/電荷泵結(jié)構(gòu)（200910087889.0）

    3. 基于鎖相環(huán)頻率綜合器應(yīng)用的改進(jìn)的數(shù)字鎖定指示器（200910303483.1）

    4. 可提高帶內(nèi)噪聲性能和降低功耗的鎖相環(huán)頻率綜合器結(jié)構(gòu)（200910303664.7）

    5. 一種可減少ΣΔ調(diào)制器量化噪聲和壓控振蕩器增益的鎖相環(huán)結(jié)構(gòu)（200910091964.0）

    6. 可編程小數(shù)分頻器（200910085878）

    7. 一種改進(jìn)的鑒相鑒頻器/電荷泵結(jié)構(gòu)（200910087888.6）

    8. 低相位噪聲的正交LC振蕩器結(jié)構(gòu)（200910090123.8）

    9. 一種可減少ΣΔ調(diào)制器量化噪聲的分?jǐn)?shù)鎖相環(huán)結(jié)構(gòu)（200910091964.0）

    獲獎(jiǎng)及榮譽(yù)：

  • 2010年度中科院微電子所十佳工作者